基于时钟偏差规划算法的数字电路工作频率优化方法专利登记公告

专利名称：基于时钟偏差规划算法的数字电路工作频率优化方法

摘要：本发明公开了一种基于时钟偏差规划算法的数字电路工作频率优化方法。所述优化方案包括路径优化潜力查找函数创建、可预估路径优化潜力的时钟偏差规划算法和关键路径重布局三个步骤。通过路径优化潜力查找函数可查找寄存器位置和其间路径优化潜力之间的关系；可预估路径优化潜力的时钟偏差规划算法在进行时钟偏差规划的同时通过路径优化潜力查找函数预支路径的优化潜力；关键路径重布局将被预支的优化潜力在物理设计中实现。实验结果表明：1)相比于只是用EDA流程的通用设计方案，本发明的优化方案可将设计性能提高8.8％-38.5％；2)方案

专利类型：发明专利

专利号：CN201210110065.2

专利申请（专利权）人：东南大学

专利发明（设计）人：黄凯

主权项：一种基于时钟偏差规划算法的数字电路工作频率优化方法，其特征是包括步骤：1)创建路径优化潜力查找函数；2)可预估路径优化潜力的时钟偏差规划算法；3)关键路径重排布；这三个步骤构成的整体优化方案，作为点工具集成到通用电子设计自动化EDA流程中；所述步骤1)中，路径优化潜力查找函数：记录了特定工艺下路径长度和路径优化潜力之间的保守关系，本路径优化潜力查找函数是由统计获得；所述步骤2)中，可预估路径优化潜力的时钟偏差规划算法，是通过预支路径优化潜力的时钟偏差规算法优化设计的工作频率；可预估路径优化潜力的时钟偏差规

专利地区：江苏